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嵌入式培訓

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集成電路設(shè)計中心企業(yè)

  
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 　　　　　　　　　　 　數(shù)字集成電路前端設(shè)計高級培訓班
   課程目標

  通過本課程的學習，使學員在掌握數(shù)字集成電路設(shè)計的基本要領(lǐng)，熟悉操作系統(tǒng)和硬件描述語言HDL,熟練使用邏輯綜合仿真工具和仿真工具，并學會IC設(shè)計公司的團隊分工與合作，相當于一年以上的數(shù)字電路設(shè)計水平和經(jīng)驗。
  培養(yǎng)對象
  1.理工科背景，有志于數(shù)字集成電路設(shè)計工作的學生和轉(zhuǎn)行人員；
  2.需要充電，提升技術(shù)水平和熟悉設(shè)計流程的在職人員；
  3.集成電路設(shè)計企業(yè)的員工內(nèi)訓。
   入學要求

        學員學習本課程應具備下列基礎(chǔ)知識：
        ◆電路系統(tǒng)的基本概念。
   班級規(guī)模及環(huán)境
       為了保證培訓效果，增加互動環(huán)節(jié)，我們堅持小班授課，每期報名人數(shù)限3到5人，多余人員安排到下一期進行。
   上課時間和地點
上課地點：【上海】：同濟大學(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈
近開課時間(周末班/連續(xù)班/晚班）： 數(shù)字集成電路前端設(shè)計高級培訓班：2025年7月14日..用心服務(wù)..........--即將開課--............................
   學時
　    ◆課時： 共5天,30學時

        ◆外地學員：代理安排食宿（需提前預定） ☆注重質(zhì)量 ☆邊講邊練
        ☆合格學員免費推薦工作
        ★實驗設(shè)備請點擊這兒查看★
   師資團隊
【趙老師】

大規(guī)模集成電路設(shè)計專家，10多年超大規(guī)模電路版圖設(shè)計經(jīng)驗，精通CMOS工藝流程、版圖設(shè)計和布局布線，精通版圖設(shè)計的各種EDA工具（如：Virtuoso/Calibre/Dracula/Assura），
熟練掌握版圖設(shè)計規(guī)則并進行驗證及修改；熟練掌握Unix/Linux操作系統(tǒng)；熟悉有CMOS設(shè)計規(guī)則、物理設(shè)計以及芯片的生產(chǎn)流程與封裝。

【王老師】

資深I(lǐng)C工程師，9年集成電路IC設(shè)計經(jīng)驗，精通chip的規(guī)劃、數(shù)字layout、analog layout和特殊電路layout。先后主持和參與了近三百顆CHIP的版圖設(shè)計工作。
從事過DAC、ADC、RF、OP、PLL、PLA、LNA、ESD、ROM、RAM等多種制程analog&digital的電路IC設(shè)計，
熟練掌握1.8V，3.3V,5V,18V,25V，40V等各種高低壓混合電路的IC設(shè)計。

【張老師】

從事數(shù)字集成電路設(shè)計10年，精通CMOS工藝流程、版圖設(shè)計和布局布線，精通VERILOG,VHDL語言，
擅長芯片前端設(shè)計和復雜項目實施的規(guī)劃管理，其領(lǐng)導開發(fā)的芯片已成功應用于數(shù)個國際知名芯片廠商之產(chǎn)品中。豐富的芯片開發(fā)經(jīng)驗，對于現(xiàn)今主流工藝下的同步數(shù)字芯片設(shè)計技術(shù)和流程有良好把握。長期專注于內(nèi)存控制器等產(chǎn)品的研發(fā)，擁有數(shù)顆規(guī)模超過百萬門的數(shù)字芯片成功流片經(jīng)驗.

★更多師資力量請見曙海師資團隊。
   新優(yōu)惠
       ◆團體報名優(yōu)惠措施：兩人95折優(yōu)惠，三人或三人以上9折優(yōu)惠 。注意：在讀學生憑學生證，即使一個人也優(yōu)惠500元。
   質(zhì)量保障

        1、培訓過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結(jié)束后免費提供一個月的技術(shù)支持，充分保證培訓后出效果；
        3、培訓合格學員可享受免費推薦就業(yè)機會。
  　　　　　 數(shù)字集成電路前端設(shè)計培訓班

1. Unix/Linux操作系統(tǒng)使用
2. 文本編輯器VIM
3. 數(shù)字電路技術(shù)基礎(chǔ)
4. 電路
5. 數(shù)字邏輯設(shè)計
6. 數(shù)字集成電路設(shè)計流程
7. Verilog HDL硬件描述語言和電路設(shè)計技術(shù)與技巧
8. 驗證工具的使用
9. 設(shè)計和驗證初步
10.PT數(shù)字電路驗證
1)驗證平臺的建立
2）測試驗證要點
12.設(shè)計綜合（synthesys）
13.PrimeTime平臺要點
14PT靜態(tài)時序分析
15.設(shè)計技巧
17.實戰(zhàn)演練：
1）RTL coding
2)綜合
18.數(shù)字前端全流程設(shè)計工具
19.相關(guān)工藝庫文件IC技術(shù)
20. 邏輯綜合初步以及SYNOPSYS DC等綜合工具的使用
21. 設(shè)計技術(shù)

重點講解數(shù)字電路設(shè)計的綜合技術(shù)的基本概念，綜合流程和工程經(jīng)驗，使學員掌握基于synopsys DC的綜合技巧。
內(nèi)容包括：
綜合機理的分析；組合電路和時序電路實現(xiàn)規(guī)則和實例分析；基于tcl綜合的流程,優(yōu)化處理和調(diào)試技術(shù)；綜合處理與后端流程的聯(lián)系；可綜合代碼技術(shù)；
SOC 靜態(tài)時序分析技術(shù)
介紹靜態(tài)時序分析技術(shù)；使學員掌握基于Synopsysy PrimeTime的靜態(tài)時序分析技術(shù)。
內(nèi)容包括：
背景分析；工具的使用；靜態(tài)時序分析模式選擇；注意事項及需深入研究的內(nèi)容

23、項目介紹。立項分析、實現(xiàn)方案的規(guī)劃。

24、SOC系統(tǒng)的設(shè)計方法學。數(shù)字設(shè)計庫的介紹，分析、創(chuàng)建，及使用。

25. 項目設(shè)計實訓:
實訓項目.
 
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上海培訓基地

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.(2014年7月11).............................................
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