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 IC Compiler 1 培訓

   課程背景
The class begins with how to load the required synthesis and physical data required by IC Compiler (data setup), followed by creating a floorplan, including power grid, to meet timing and routeability throughout the flow (design planning). The placement flow focuses on optimizing the placement and logic for timing, congestion, power, and scan-chain ordering. The CTS unit covers controlling and building clock trees and performing additional timing optimization, followed by routing of the clock nets. In the routing unit, you will learn the signal routing and optimization steps based on the Zroute mode, including concurrent via doubling and antenna fixing. The chip finishing unit includes steps to improve yield and reliability, including wire spreading/widening, diode insertion, inserting filler cells, redundant via insertion, and metal filling.
Every lecture is accompanied by a comprehensive hands-on lab.
   課程目標
  • Perform data setup, which includes loading required synthesis and physical data, creating a Milkyway design library, and applying common timing and optimization controls
  • Create a non-hierarchical chip-level floorplan that will be routable and will achieve timing closure
  • Perform placement and related optimizations to minimize timing violations, congestion, and power
  • Analyze congestion maps and timing reports
  • Perform pre-CTS power optimization
  • Perform clock tree synthesis
  • Analyze clock and timing results post-CTS
  • Route the clock nets
  • Execute a Zroute-based signal routing flow, with concurrent via doubling and antenna fixing
  • Analyze and fix physical DRC and LVS violations
  • Perform functional ECOs
  • Perform chip finishing steps
  • Generate output files required for final validation/verification
   班級規模及環境--熱線:4008699035 手機:15921673576/13918613812( 微信同號)
       為了保證培訓效果,增加互動環節,我們堅持小班授課,每期報名人數限3到5人,多余人員安排到下一期進行。注意:本課程一旦開課不予退費。
   時間地點
上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協同大廈
近開課時間(周末班/連續班/晚班):
IC Compiler 1班:2025年4月21日--即將開課--............................
   學時和費用
        ★課時: 請咨詢在線客服

        ◆外地學員:代理安排食宿(需提前預定)
        ☆注重質量
        ☆邊講邊練

        ☆合格學員免費推薦工作

        

        專注高端培訓17年,曙海提供的課程得到本行業的廣泛認可,學員的能力
        得到大家的認同,受到用人單位的廣泛贊譽。

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   新優惠
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   質量保障

        1、培訓過程中,如有部分內容理解不透或消化不好,可免費在以后培訓班中重聽;
        2、培訓結束后免費提供半年的技術支持,充分保證培訓后出效果;
        3、培訓合格學員可享受免費推薦就業機會。 。專注高端培訓17年,曙海提供的課程得到本行業的廣泛認可,學員的能力得到大家的認同,受到用人單位的廣泛贊譽。

   課程大綱:

IC Compiler 1 培訓

課程內容:

階段 1
  • Introduction and Overview
  • Data Setup and Basic Flow
  • Design Planning
階段 2
  • Design Planning (Lab continued)
  • Placement
  • Clock Tree Synthesis
階段 3
  • Clock Tree Synthesis (Lab continued)
  • Routing
  • Chip Finishing
  • Customer Support
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.(2014年7月11)..................................................................................................
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